VHDL入門與應用

第1章 緒論                  
 1.1 EDA工具的歷史及現(xiàn)狀                  
 1.2 硬件描述語言HDL                  
 1.3 VHDL簡述                  
 1.3.1 VHDL的誕生                  
 1.3.2 VHDL語言特點                  
 1.3.3 VHDL設計簡述                  
 1.3.4 VHDL的結構體描述                  
 1.4 一個簡單實例                  
 1.5 小結                  
 第2章 VHDL語言基礎                  
 2.1 VHDL程序設計基本結構                  
 2.1.1 實體聲明                  
 2.1.2 結構體                  
 2.1.3 配置                  
 2.1.4 程序包                  
 2.2 VHDL中的數(shù)據(jù)                  
 2.2.1 標志符                  
 2.2.2 數(shù)據(jù)對象                  
 2.2.3 VHDL數(shù)據(jù)類型                  
 2.2.4 用戶自定義類型                  
 2.2.5 類型聲明與子類型聲明的地方                  
 2.3 VHDL中的表達式                  
 2.3.1 操作符                  
 2.3.2 操作數(shù)                  
 2.4 小結                  
 第3章 VHDL中的描述語句                  
 3.1 順序描述語句                  
 3.1.1 對象與賦值語句                  
 3.1.2 變量賦值與信號賦值                  
 3.1.3 if語句                  
 3.1.4 case語句                  
 3.1.5 loop語句                  
 3.1.6 子程序                  
 3.1.7 return語句                  
 3.1.8 wait語句                  
 3.1.9 null語句                  
 3.2 并行描述語句                  
 3.2.1 進程語句                  
 3.2.2 塊語句                  
 3.2.3 順序描述語句的并行版本                  
 3.2.4 組件例化語句                  
 3.2.5 生成語句                  
 3.3 子程序                  
 3.3.1 子程序聲明                  
 3.3.2 子程序主體                  
 3.3.3 子程序重載                  
 3.3.4 決斷函數(shù)                  
 3.4 小結                  
 第4章 編程實例                  
 4.1 編碼器                  
 4.2 譯碼器                  
 4.3 加法器                  
 4.4 寄存器                  
 4.5 移位寄存器                  
 4.6 計數(shù)器                  
 4.7 串并轉換器                  
 4.8 并串轉換器                  
 4.9 存儲器的實現(xiàn)和應用                  
 4.10 信號發(fā)生器                  
 4.11 更為復雜的信號發(fā)生器                  
 4.12 序列計數(shù)器                  
 4.13 一個具有層次化的設計示例----微處理器                  
 4.13.1 AM2901結構簡介                  
 4.13.2 為AM2901建立一個程序包                  
 4.13.3 AM2901功能設計                  
 4.13.4 AM2901頂層數(shù)據(jù)包                  
 4.13.5 AM2901頂層實體                  
 4.14 小結                  
 第5章 MAX+plusⅡ及其應用                  
 5.1 MAX+plusⅡ簡介與應用例解                  
 5.2 安裝MAX+plusⅡ 9.4                  
 5.3 啟動MAX+plusⅡ                  
 5.4 感性認識----編寫一個計數(shù)器counter                  
 5.4.1 建立VHDL語言的設計輸入文件                  
 5.4.2 建立工程                  
 5.4.3 設置編譯選項, 編譯綜合工程                  
 5.4.4 仿真                  
 5.4.5 器件編程                  
 5.5 利用Altera公司的庫快速生成程序                  
 5.6 小結                  
 第6章 Quartus及其應用                  
 6.1 Quartus 2000.02 版軟件包                  
 6.2 安裝Quartus 2000.02                  
 6.3 感性認識----編寫一個除法小程序                  
 6.3.1 使用向導建立工程divide                  
 6.3.2 建立設計輸入文件divider.vhd                  
 6.3.3 設定編譯選項                  
 6.3.4 編譯文件                  
 6.3.5 編輯波形仿真文件                  
 6.3.6 進行仿真并分析結果                  
 6.4 除法器電路的一些改進                  
 6.5 Quartus中Altera庫函數(shù)                  
 6.5.1 直接調用方式                  
 6.5.2 使用Quartus的Megawizard Plus_In Manager                  
 6.6 小結                  
 第7章 VHDL編程指南                  
 7.1 一些相關設計理論                  
 7.1.1 使用自頂向下的系統(tǒng)級設計方法                  
 7.1.2 使用狀態(tài)機的設計方法                  
 7.1.3 使用流水線的設計方法                  
 7.2 設計中的一些重要概念                  
 7.2.1 組合邏輯和時序邏輯                  
 7.2.2 Latch和Flip_flop                  
 7.2.3 資源庫的使用                  
 7.2.4 片內存儲器RAM的使用                  
 7.2.5 高阻狀態(tài)設置                  
 7.3 可編程邏輯器件CPLD和FPGA                  
 7.3.1 CPLD簡介                  
 7.3.2 FPGA簡介                  
 7.4 小結                  
 附錄A VHDL保留字                  
 附錄B 部分FPGA廠家名錄                  
 附錄C EDA工具軟件一覽表                  
 C.1 VHDL編輯軟件一覽表                  
 C.2 RTL級綜合工具軟件一覽表                  
 C.3 VHDL仿真工具軟件一覽表                  
 C.4 FPGA編程軟件一覽表                  
 附錄D 預定義的程序包                  
 D.1 std_logic_1164程序包                  
 D.2 std_logic_arith程序包                  
 D.3 std_logic_unsigned程序包                  
 D.4 std_logic_signed程序包                  
 附錄E VHDL語法的BNF范式表示                  
 參考文獻                  
 后 記