數(shù)字電子技術

第1章 數(shù)字電路基礎
1.1 數(shù)制與轉(zhuǎn)換
1.1.1 進位計數(shù)制
1.1.2 數(shù)制轉(zhuǎn)換
1.2 常用代碼
1.2.1 8421BCD碼，
1.2.2 2421BCD碼和5421BCD碼
1.2.3 余3BCD碼
1.2.4 可靠性代碼
1.3 數(shù)字電路概述
1.3.1 數(shù)字信號與模擬信號
1.3.2 數(shù)字電路
1.3.3 研究數(shù)字電路的基本工具
1.4 邏輯運算與常用邏輯門電路
1.4.1 三種基本邏輯關系與基本邏輯門電路
1.4.2 常用復合邏輯：
習題
第2章 邏輯函數(shù)化簡
2.1 布爾代數(shù)的基本公式和規(guī)則
2.1.1 基本公式
2.1.2 基本規(guī)則
2.2 邏輯函數(shù)的代數(shù)化簡法
2.2.1 化簡的目的
2.2.2 邏輯函數(shù)化簡原則
2.2.3 代數(shù)法化簡舉例
2.3 邏輯函數(shù)的卡諾圖化簡法
2.3.1 卡諾圖的結構
2.3.2 邏輯函數(shù)的卡諾圖表示法
2.3.3 卡諾圖化簡邏輯函數(shù)的原理
2.3.4 用卡諾圖化簡邏輯函數(shù)的步驟
2.4 包含無關項的邏輯函數(shù)的化簡
2.4.1 含有無關項的邏輯函數(shù)
2.4.2 含有無關項的邏輯函數(shù)的最簡與或式
2.5 邏輯函數(shù)的五種常用表達形式
2.5.1 與或式及與非式
2.5.2 與或非式、或與式及或非式
2.5.3 含有無關項的邏輯函數(shù)的五種形式
習題
第3章 組合邏輯電路
3.1 集成邏輯門
3.1.1 LSTTL與非門
3.1.2 其他TIL門電路
3.1.3 OC門
3.1.4 三態(tài)門及使能端和功能端
3.1.5 TTL門電路多余輸入端子的處理方法
3.1.6 MOS集成邏輯門
3.2 組合邏輯電路的分析
3.2.1 組合邏輯電路的特點
3.2.2 組合邏輯電路的一般分析方法舉例
3.3 組合邏輯電路的設計
3.4 組合電路設計中的險象及其消除
3.4.1 險象產(chǎn)生的原因
3.4.2 險象的檢查與消除方法
習題
第4章 集成組合電路的應用
4.1 譯碼器在組合電路中的應用
4.1.1 含有74LSl38譯碼器的組合電路的分析
4.1.2 74LSl38譯碼器的組合電路設計
4.2 數(shù)據(jù)選擇器在組合電路中的應用
4.2.1 含有數(shù)據(jù)選擇器的組合電路的分析
4.2.2 用數(shù)據(jù)選擇器設計組合電路
4.3 集成組合電路用途的擴展
4.3.1 3-8譯碼器74LSl38的功能擴展
4.3.2 數(shù)據(jù)選擇器的功能擴展
4.3.3 加法器用途的擴展
4.4 組合集成電路綜合應用舉例
習題
第5章 時序邏輯電路
5.1 觸發(fā)器
5.1.1 基本RS觸發(fā)器
5.1.2 RS觸發(fā)器
5.1.3 D觸發(fā)器.：
5.1.4 JK觸發(fā)器
5.1.5 T觸發(fā)器和T’觸發(fā)器
5.1.6 集成觸發(fā)器的觸發(fā)方式及符號圖
5.2 同步時序電路的分析
5.3 異步時序電路的分析
5.4 同步時序電路的設計
5.4.1 莫爾型同步時序電路設計舉例
5.4.2 米里型時序邏輯電路設計舉例
習題
第6章 集成時序電路的應用
6.1 十進制計數(shù)器
6.1.1 異步集成計數(shù)器74LS90
6.1.2 同步十進制可逆計數(shù)器74LSl92
6.2 十六進制計數(shù)器
6.3 寄存器和移位寄存器
6.3.1 鎖存器
6.3.2 基本寄存器
6.3.3 移位寄存器
習題
第7章 脈沖的產(chǎn)生和變換
7.1 555定時器電路
7.1.1 或非門組成的基本：RS觸發(fā)器
7.1.2 555定時器電路的組成
7.1.3 555定時器的工作原理及功能表
7.2 施密特觸發(fā)器；
7.2.1 用555定時器構成的施密特觸發(fā)器
7.2.2 施密特觸發(fā)器的主要應用
7.3 單穩(wěn)態(tài)觸發(fā)器
7.3.1 單穩(wěn)態(tài)觸發(fā)器的電路組成
7.3.2 電路工作原理
7.3.3 單穩(wěn)態(tài)觸發(fā)器的主要應用
7.4 多諧振蕩器
7.4.1 多諧振蕩器工作原理
7.4.2 多諧振蕩器應用舉例
習題
第8章 數(shù)／模與模，數(shù)轉(zhuǎn)換
8.1 數(shù)／模轉(zhuǎn)換
8.1.1 D／A轉(zhuǎn)換在數(shù)字系統(tǒng)中的應用
8.1.2 R.2 R倒T型DAC電路
8.1.3 恒流源權電流DAC電路
8.1.4 DAC的主要性能指標
8.2 模／數(shù)轉(zhuǎn)換
8.2.1 時序分配器
8.2.2 逐次逼近型AID轉(zhuǎn)換器的組成
8.2.3 逐次逼近式ADC工作過程
習題
第9章 存儲器與可編程邏輯器件
9.1 隨機存取存儲器.
9.1.1 RAM的結構及存儲容量
9.1.2 六管靜態(tài)MOS基本存儲電路（SMOS）
9.1.3 動態(tài)RAM（DRAM）
9.2 只讀存儲器（ROM）
9.2.1 ROM電路原理
9.2.2 ROM在組合電路中的應用
9.2.3 用于研究開發(fā)或者小批量生產(chǎn)的ROM
9.3 可編程邏輯器件
9.3.1 可編程邏輯陣列PLA的功能與應用
9.3.2 其他可編程邏輯器件簡介
9.4 組合邏輯電路設計方法總結
習題
附錄一 數(shù)字電子技術實驗
實驗一 門電路邏輯功能及主要參數(shù)測試
一、實驗前準備
二、實驗內(nèi)容和步驟：
三、實驗報告
實驗二 組合邏輯電路的分析與設計
一、實驗前準備
二、驗內(nèi)容和步驟
三、實驗報告
實驗三觸發(fā)器功能測試及應用
一、實驗前準備
二、實驗內(nèi)容和步驟
三、實驗報告
實驗四計數(shù)、譯碼、顯示綜合實驗
一、實驗前準備
二、實驗內(nèi)容和步驟
三、實驗報告
實驗五移位寄存器功能測試及應用
一、實驗前準備
二、實驗內(nèi)容和步驟
三、實驗報告
實驗六555集成定時器及其應用
一、實驗前準備
二、實驗內(nèi)容和步驟
三、實驗報告
實驗七D／A轉(zhuǎn)換與A／D轉(zhuǎn)換實驗
一、實驗前準備
二、實驗內(nèi)容和步驟
三、實驗報告
附錄二常用數(shù)字集成電路
一、系列TTL數(shù)字邏輯電路
二、4000系列CMOS數(shù)字邏輯電路
主要參考文獻