ASIC芯片設(shè)計(jì)：從實(shí)踐到提高

叢書序
前言
第1章 ASIC簡介
1.1 ASIC的發(fā)展
1.2 ASIC的類型
1.3 ASIC設(shè)計(jì)流程
第2章 常用EDA工具的使用方法
2.1 FPGA設(shè)計(jì)工具——QuartusⅡ
2.2 FPGA設(shè)計(jì)軟件——ISE
2.3 ModeslSim仿真工具
2.4 高效綜合軟件——Synplify/Synplify Pro
2.5 Synopsys綜合工具——Design Compiler（DC）
2.6 Cadence仿真工具——NC-Verilog
第3章 Verilog HDL語言基礎(chǔ)
3.1 Verilog HDL的基本結(jié)構(gòu)
3.2 數(shù)據(jù)類型
3.3 參數(shù)定義、宏替換及模擬時(shí)間單位的定標(biāo)
3.4 操作符
3.5 Verilog HDL行為描述
3.6 Verilog HDL結(jié)構(gòu)描述
3.7 Verilog HDL的編碼風(fēng)格
3.8 實(shí)例分析
第4章 VHDL語言基礎(chǔ)
4.1 VHDL程序結(jié)構(gòu)
4.2 VHDL語言要素及其分類
4.3 VHDL語法基礎(chǔ)
4.4 實(shí)例分析
第5章 驗(yàn)證技術(shù)
5.1 驗(yàn)證的策略和手段
5.2 構(gòu)建測試平臺（Testbench）
5.3 仿真技術(shù)
5.4 靜態(tài)時(shí)序分析（STA）
5.5 實(shí)例分析
第6章 綜合技術(shù)
第7章 FPGA驗(yàn)證技術(shù)
第8章 ASIC版圖設(shè)計(jì)技術(shù)