計算機硬件技術基礎

定　價：￥29.80

作　者：	錢曉捷主編
出版社：	機械工業(yè)出版社
叢編項：	計算機基礎教育課程體系規(guī)劃教材
標　簽：	維修

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ISBN：	9787111291053	出版時間：	2010-01-01	包裝：	平裝
開本：	16開	頁數：	262	字數：

內容簡介

　　《計算機硬件技術基礎》以IA-32處理器和32位個人計算機系統為實例，從軟件開發(fā)、計算機系統應用的角度，論述了計算機硬件技術，包括IA-32處理器的發(fā)展和微機組成、數據表示、數字邏輯基礎、處理器結構和指令系統、總線系統、存儲系統、輸入輸出接口，還特別介紹了精簡指令集計算機、高速緩沖存儲器、存儲管理、指令流水線、多媒體指令、超標量、動態(tài)執(zhí)行、多線程、多核等提高處理器性能的先進技術?！队嬎銠C硬件技術基礎》適合作為普通高等院校面向軟件開發(fā)、系統應用的計算機專業(yè)的“計算機組成原理”或“計算機組織與結構”課程的教材或參考書，同時也適合作為非計算機專業(yè)的“計算機硬件技術”課程的教材或參考書。此外，《計算機硬件技術基礎》面向一般學生和普通讀者寫作，起點低、內容精練、敘述深入淺㈩，適合軟件丁程、信息技術及電子、通信和自控等電類專業(yè)的本科學生使用，也適合計算機等專業(yè)的高職高專、成教學生以及計算機應用開發(fā)人員、希望深入學習計算機硬件技術的普通讀者和培訓班學員使用。

作者簡介

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圖書目錄

前言
第1章計算機系統概述
1.1 計算機的發(fā)展
1.1.1 計算機的發(fā)展概況
1.1.2 微型計算機的發(fā)展
1.2 Intel80x86系列處理器
1.2.1 16位80x86處理器
1.2.2 IA-32處理器
1.2.3 Intel64處理器
1.3 計算機系統組成
1.3.1 馮·諾伊曼計算機結構
1.3.2 微型計算機的硬件系統
1.3.3 PC微機結構
1.3.4 計算機系統的層次結構
1.3.5 計算機的軟件系統
第1章總結
第1章習題
第2章數據表示
2.1 數制
2.1.1 二進制和十六進制
2.1.2 數制之間的轉換
2.2 整數編碼
2.2.1 定點整數格式
2.2.2 有符號整數編碼
2.3 字符編碼
2.3.1 BCD
2.3.2 ASCII
2.3.3 Unicode
2.4 實數編碼
2.4.1 浮點數據格式
2.4.2 浮點數的舍入控制
2.5 校驗編碼
2.5.1 奇偶校驗碼
2.5.2 海明碼
2.5.3 循環(huán)冗余碼
第2章總結
第2章習題
第3章數字邏輯基礎
3.1 邏輯代數
3.1.1 邏輯關系
3.1.2 邏輯代數的運算規(guī)則
3.1.3 邏輯函數的形式、轉換及化簡
3.2 邏輯門電路
3.2.1 門電路實現
3.2.2 集成電路
3.2.3 三態(tài)門
3.3 組合邏輯電路
3.3.1 編碼器
3.3.2 譯碼器
3.3.3 加法器
3.4 時序邏輯電路
3.4.1 觸發(fā)器
3.4.2 寄存器
3.4.3 計數器
3.5 可編程邏輯器件
3.5.1 PLD器件
3.5.2 電子設計自動化
第3章總結
第3章習題
第4章處理器
4.1 處理器組成
4.1.1 控制器
4.1.2 運算器
4.2 處理器結構
4.2.1 處理器的基本結構
4.2.2 8086的功能結構
4.2.3 80386的功能結構
4.2.4 Pentium的功能結構
4.3 寄存器
4.3.1 通用寄存器
4.3.2 標志寄存器
4.3.3 專用寄存器
4.4 存儲器組織
4.4.1 存儲模型
4.4.2 工作方式
4.4.3 邏輯地址
第4章總結
第4章習題
第5章指令系統
5.1 指令格式
5.1.1 指令編碼
5.1.2 IA32指令格式
5.2 尋址方式
5.2.1 數據尋址
5.2.2 指令尋址
5.2.3 堆棧及堆棧尋址
5.3 通用指令及其功能
5.3.1 數據傳送類指令
5.3.2 算術運算類指令
5.3.3 位操作類指令
5.3.4 控制轉移類指令
5.4 匯編語言基礎
5.4.1 語句格式
5.4.2 源程序框架
5.4.3 開發(fā)過程
5.5 精簡指令集計算機技術
5.5.1 復雜指令集和精簡指令集
5.5.2 RISC技術的主要特點
5.5.3 MIPS處理器
第5章總結
第5章習題
第6章總線系統
6.1 總線技術
6.1.1 總線類型
6.1.2 總線的數據傳輸
6.1.3 總線信號和總線時序
6.2 8086的引腳信號
6.2.1 地址/數據信號
6.2.2 讀寫控制信號
6.2.3 其他控制信號
6.3 8086的總線時序
6.3.1 寫總線周期
6.3.2 讀總線周期
6.4 Pentium處理器的引腳和時序
6.4.1 引腳定義
6.4.2 總線周期
6.5 微機系統總線
6.5.1 PC機總線的發(fā)展
6.5.2 ISA總線
6.5.3 PCI總線
6.5.4 USB總線
第6章總結
第6章習題
第7章存儲系統
7.1 存儲系統的層次結構
7.1.1 技術指標
7.1.2 層次結構
7.1.3 局部性原理
7.2 主存儲器
7.2.1 讀寫存儲器
7.2.2 只讀存儲器
7.2.3 存儲器地址譯碼
7.2.4 主存空間分配
7.3 高速緩沖存儲器
7.3.1 工作原理
7.3.2 地址映射
7.3.3 替換算法
7.3.4 寫入策略
7.3.5 80486的L1Cache
7.3.6 Pentium的L1Cache
7.4 存儲管理
7.4.1 段式存儲管理
7.4.2 頁式存儲管理
第7章總結
第7章習題
第8章輸入輸出接口
8.1 I/O接口概述
8.1.1 I/O接口的典型結構
8.1.2 I/O端口的編址
8.1.3 輸入輸出指令
8.2 外設數據傳送方式
8.2.1 無條件傳送
8.2.2 查詢傳送
8.2.3 中斷傳送
8.2.4 中斷控制系統
8.2.5 DMA傳送
8.3 常用輸入輸出接口
8.3.1 定時控制接口
8.3.2 并行接口
8.3.3 異步串行通信接口
8.3.4 模擬接口
第8章總結
第8章習題
第9章處理器性能提高技術
9.1 并行處理技術
9.1.1 并行性概念
9.1.2 并行計算機結構分類
9.1.3 計算機性能評測
9.2 指令級并行
9.2.1 指令流水線技術
9.2.2 超標量技術
9.2.3 動態(tài)執(zhí)行技術
9.2.4 超長指令字技術
9.3 數據級并行
9.3.1 向量處理機
9.3.2 多媒體指令
9.4 線程級并行
9.4.1 同時多線程技術
9.4.2 單芯片多處理器技術
第9章總結
第9章習題
參考文獻