勇敢的芯伴你玩轉Nios II

定　價：￥45.00

作　者：	吳厚航
出版社：	清華大學出版社
叢編項：
標　簽：	暫缺

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ISBN：	9787302437840	出版時間：	2016-07-01	包裝：
開本：	16開	頁數(shù)：	191	字數(shù)：

內容簡介

　　本書使用Altera公司的Cyclone Ⅳ FPGA器件，由淺入深地引領讀者從嵌入式系統(tǒng)設計的大處著手，玩轉軟核處理器Nios Ⅱ。基于特定的FPGA實驗平臺，既有足夠的理論知識深度作支撐，也有豐富的例程進行實踐學習，并且穿插著筆者多年FPGA學習和開發(fā)過程中的各種經(jīng)驗和技巧。對于希望快速入手嵌入式系統(tǒng)軟硬件開發(fā)的初學者，以及希望從系統(tǒng)層面提升嵌入式開發(fā)能力的學習者，本書都是很好的選擇。

作者簡介

　　吳厚航，[網(wǎng)名特權同學]：從事FPGA開發(fā)設計與板級硬件設計工作，專注于FPGA在數(shù)據(jù)采集、實時控制、傳輸協(xié)議實現(xiàn)、嵌入式系統(tǒng)等方面的應用。擅長記錄、分析并總結經(jīng)驗及技巧。個人技術博客在業(yè)內有的口碑。在著名電子網(wǎng)站EDN China創(chuàng)建的FPGA/CPLD助學小組成員過萬，提供了眾多適合入門和進階的FPGA/CPLD實驗例程以及相關資料，幫助眾多的初學者邁入FPGA開發(fā)的殿堂。

圖書目錄

第1章基于Nios Ⅱ處理器的嵌入式系統(tǒng)1．1片上系統(tǒng)概述1．2Nios Ⅱ的優(yōu)勢在哪里1．3基于Nios Ⅱ處理器的FPGA開發(fā)流程第2章實驗平臺“勇敢的芯”板級電路詳解2．1板級電路整體架構2．2電源電路2．3復位與時鐘電路2．3．1關于FPGA器件的時鐘2．3．2關于FPGA器件的復位2．3．3實驗平臺電路解析2．4FPGA下載配置電路2．5SRAM接口電路2．6ADC/DAC芯片電路2．7UART接口電路2．8RTC接口電路2．94×4矩陣按鍵電路2．10VGA顯示接口電路2．11蜂鳴器、數(shù)碼管、流水燈、撥碼開關電路2．12超聲波接口、外擴LCD接口電路第3章Qsys系統(tǒng)創(chuàng)建3．1Qsys系統(tǒng)概述3．2Qsys總線互連3．3Quartus Ⅱ工程創(chuàng)建3．4進入Qsys系統(tǒng)3．5Qsys界面簡介3．6新建Qsys系統(tǒng)3．7保存Qsys系統(tǒng)3．8加載Qsys系統(tǒng)勇敢的芯伴你玩轉Nios Ⅱ第4章Qsys通用組件添加與互連4．1時鐘組件添加與設置4．2Nios Ⅱ處理器添加與設置4．3RAM組件添加與配置4．4Nios Ⅱ處理器復位向量與異常向量地址設置4．5System ID組件添加與配置4．6JTAG UART組件添加與配置4．7Timer組件添加與配置4．8UART組件添加與配置4．9蜂鳴器PIO組件添加與配置4．10撥碼開關PIO組件添加與配置第5章Qsys互連總線概述5．1嵌入式系統(tǒng)的總線5．2AvalonMM總線5．2．1AvalonMM總線寫數(shù)據(jù)操作實例解析5．2．2AvalonMM總線讀數(shù)據(jù)操作實例解析5．3AvalonST總線第6章Qsys自定義組件設計6．1數(shù)碼管組件6．1．1功能概述6．1．2配置寄存器說明6．1．3組件創(chuàng)建與配置6．1．4組件添加與配置6．1．5組件互連與引出6．2ADC組件6．2．1功能概述6．2．2配置寄存器說明6．2．3組件創(chuàng)建與配置6．2．4組件添加與配置6．2．5組件互連與引出6．3DAC組件6．3．1功能概述6．3．2配置寄存器說明6．3．3組件創(chuàng)建與配置6．3．4組件添加與配置6．3．5組件互連與引出6．4超聲波測距組件6．4．1功能概述6．4．2配置寄存器說明6．4．3組件創(chuàng)建與配置6．4．4組件添加與配置6．4．5組件互連與引出6．5RTC組件6．5．1功能概述6．5．2配置寄存器說明6．5．3組件創(chuàng)建與配置6．5．4組件添加與配置6．5．5組件互連與引出6．6矩陣按鍵組件6．6．1功能概述6．6．2配置寄存器說明6．6．3組件創(chuàng)建與配置6．6．4組件添加與配置6．6．5組件互連與引出第7章Qsys系統(tǒng)生成7．1中斷連接7．2地址分配7．3系統(tǒng)生成7．4Qsys系統(tǒng)例化模板第8章Quartus Ⅱ工程設計實現(xiàn)8．1Verilog頂層文件設計8．2語法檢查8．3引腳分配8．4系統(tǒng)編譯第9章軟件開發(fā)工具EDS9．1EDS軟件開啟9．2BSP工程創(chuàng)建9．3開啟BSP Editor9．4BSP Editor設置9．5BSP工程編譯9．6工程創(chuàng)建9．7C代碼源文件創(chuàng)建9．8軟件應用工程編譯9．9移除當前工程9．10加載工程9．11移植工程第10章軟件實驗例程10．1Nios Ⅱ實例之Hello NIOS II10．1．1軟件功能概述10．1．2軟件代碼解析10．1．3板級調試10．2Nios Ⅱ實例之System ID與Timestamp10．2．1軟件功能概述10．2．2軟件代碼解析10．2．3板級調試10．3Nios Ⅱ實例之蜂鳴器定時鳴叫10．3．1軟件功能概述10．3．2軟件代碼解析10．3．3板級調試10．4Nios Ⅱ實例之撥碼開關輸入GIO控制10．4．1軟件功能概述10．4．2軟件代碼解析10．4．3板級調試10．5Nios Ⅱ實例之秒定時數(shù)碼管顯示10．5．1軟件功能概述10．5．2軟件代碼解析10．5．3板級調試10．6Nios Ⅱ實例之DAC遞增輸出10．6．1軟件功能概述10．6．2軟件代碼解析10．6．3板級調試10．7Nios Ⅱ實例之ADC采集打印10．7．1軟件功能概述10．7．2軟件代碼解析10．7．3板級調試10．8Nios Ⅱ實例之UART收發(fā)10．8．1軟件功能概述10．8．2軟件代碼解析10．8．3板級調試10．9Nios Ⅱ實例之RTCUART時間打印10．9．1軟件功能概述10．9．2軟件代碼解析10．9．3板級調試10．10Nios Ⅱ實例之RTCUART時間重置10．10．1軟件功能概述10．10．2軟件代碼解析10．10．3板級調試10．11Nios Ⅱ實例之超聲波測距10．11．1軟件功能概述10．11．2軟件代碼解析10．11．3板級調試10．12Nios Ⅱ實例之倒車雷達10．12．1軟件功能概述10．12．2軟件代碼解析10．12．3板級調試10．13Nios Ⅱ實例之矩陣按鍵值采集10．13．1軟件功能概述10．13．2軟件代碼解析10．13．3板級調試10．14Nios Ⅱ實例之矩陣按鍵可調的ADC/DAC實例10．14．1軟件功能概述10．14．2軟件代碼解析10．14．3板級調試10．15Nios Ⅱ實例之計算器10．15．1軟件功能概述10．15．2軟件代碼解析10．15．3板級調試第11章FPGA器件的代碼固化11．1嵌入式軟件HEX文件生成11．2程序存儲器初始化文件加載11．3JIC燒錄文件生成11．4JTAG燒錄配置