計(jì)算機(jī)組成原理

第1章 計(jì)算機(jī)概述
1．1 計(jì)算機(jī)簡(jiǎn)介
1．1．1 計(jì)算機(jī)定義和特性
1．1．2 計(jì)算機(jī)的分類(lèi)
1．1．3 計(jì)算機(jī)的應(yīng)用
1．2 計(jì)算機(jī)發(fā)展簡(jiǎn)史
1．3 計(jì)算機(jī)的組成與結(jié)構(gòu)
1．3．1 計(jì)算機(jī)系統(tǒng)的基本組成
1．3．2 計(jì)算機(jī)系統(tǒng)的層次結(jié)構(gòu)
1．4 實(shí)驗(yàn)設(shè)計(jì)
1．4．1 計(jì)算機(jī)硬件的組成
1．4．2 自控／計(jì)控原理實(shí)驗(yàn)機(jī)的硬件組成
1．4．3 EL實(shí)驗(yàn)機(jī)的硬件組成
習(xí)題1
第2章 運(yùn)算基礎(chǔ)
2．1 邏輯電路基本
2．2 數(shù)值數(shù)據(jù)的編碼表示
2．2．1 數(shù)制和數(shù)制轉(zhuǎn)換
2．2．2 數(shù)據(jù)的編碼和表示
2．2．3 機(jī)器數(shù)表示形式的變換
2．2．4 十進(jìn)制數(shù)的二進(jìn)制編碼表示
2．3 非數(shù)值數(shù)據(jù)的編碼表示
2．3．1 邏輯數(shù)據(jù)
2．3．2 西文字符
2．3．3 漢字字符
2．3．4 多媒體信息
2．4 檢錯(cuò)碼和糾錯(cuò)碼
2．4．1 奇偶校驗(yàn)碼
2．4．2 海明校驗(yàn)碼
2．4．3 CRC校驗(yàn)碼
2．5 實(shí)驗(yàn)設(shè)計(jì)
2．5．1 PC中的寄存器組
2．5．2 AEDK實(shí)驗(yàn)機(jī)的寄存器組
2．5．3 EL實(shí)驗(yàn)機(jī)的寄存器組
習(xí)題2
第3章 機(jī)器數(shù)的運(yùn)算方法和運(yùn)算器
3．1 加法器
3．1．1 半加器與全加器
3．1．2 串行進(jìn)位與并行進(jìn)位
3．1．3 算術(shù)邏輯運(yùn)算部件
3．2 機(jī)器數(shù)的加減法運(yùn)算
3．2．1 原碼加減法
3．2．2 補(bǔ)碼加減法
3．2．3 溢出及檢測(cè)
3．2．4 補(bǔ)碼加減法運(yùn)算器
3．3 定點(diǎn)乘法運(yùn)算
3．3．1 原碼一位乘法運(yùn)算
3．3．2 原碼兩位乘法運(yùn)算
3．3．3 補(bǔ)碼一位乘法運(yùn)算
3．3．4 補(bǔ)碼兩位乘法運(yùn)算
3．3．5 陣列乘法器
3．4 定點(diǎn)除法運(yùn)算
3．4．1 定點(diǎn)原碼除法運(yùn)算
3．4．2 定點(diǎn)補(bǔ)碼除法運(yùn)算
3．4．3 陣列除法器
3．5 浮點(diǎn)數(shù)的算術(shù)運(yùn)算
3．5．1 浮點(diǎn)數(shù)加減法運(yùn)算
3．5．2 浮點(diǎn)數(shù)乘、除法運(yùn)算
3．6 十進(jìn)制數(shù)加法、減法
3．7 實(shí)驗(yàn)設(shè)計(jì)
3．7．1 PC中的運(yùn)算器
3．7．2 AEDK實(shí)驗(yàn)機(jī)的運(yùn)算器
3．7．3 EL實(shí)驗(yàn)機(jī)的運(yùn)算器
習(xí)題3
第4章 指令系統(tǒng)
4．1 指令格式和尋址方法
4．1．1 指令格式
4．1．2 尋址方式
4．1．3 指令的種類(lèi)
4．2 指令編碼
4．3 格式設(shè)計(jì)舉例
4．4 指令的執(zhí)行
4．4．1 指令部件
4．4．2 指令的執(zhí)行方式
4．5 CISC和RISC
4．6 實(shí)驗(yàn)設(shè)計(jì)
4．6．1 PC的指令系統(tǒng)
4．6．2 AEDK實(shí)驗(yàn)機(jī)的指令系統(tǒng)
4．6．3 EL實(shí)驗(yàn)機(jī)的指令系統(tǒng)
習(xí)題4
第5章 中央處理器
5．1 中央處理器的結(jié)構(gòu)與功能
5．1．1 中央處理器的功能
5．1．2 中央處理器的基本結(jié)構(gòu)
5．1．3 中央處理器的控制流程
5．1．4 中央處理器的時(shí)序控制方式
5．2 指令執(zhí)行過(guò)程
5．3 控制器的設(shè)計(jì)
5．3．1 組合邏輯控制器
5．3．2 PLA控制
5．3．3 微程序控制器
5．4 實(shí)驗(yàn)設(shè)計(jì)
5．4．1 PC中程序的執(zhí)行
5．4．2 AEDK實(shí)驗(yàn)機(jī)的控制器
5．4．3 EL實(shí)驗(yàn)機(jī)的控制器
習(xí)題5
第6章 存儲(chǔ)器
6．1 存儲(chǔ)器概述
6．1．1 存儲(chǔ)器的基本概念
6．1．2 存儲(chǔ)器的性能指標(biāo)
6．1．3 存儲(chǔ)器的分類(lèi)
6．2 半導(dǎo)體讀寫(xiě)存儲(chǔ)器
6．2．1 半導(dǎo)體基本存儲(chǔ)單元
6．2．2 半導(dǎo)體RAM芯片
6．2．3 用存儲(chǔ)芯片構(gòu)成主存儲(chǔ)器
6．3 半導(dǎo)體只讀存儲(chǔ)器
6．3．1 掩膜只讀存儲(chǔ)器（Masked ROM）
6．3．2 可編程ROM（PROM）
6．3．3 可擦除和編程的ROM（EPROM）
6．3．4 電擦除電改寫(xiě)只讀存儲(chǔ)器（EEPROM）
6．4 主存儲(chǔ)器
6．4．1 容量
6．4．2 時(shí)間
6．4．3 周期
6．4．4 主存分類(lèi)
6．5 高速緩沖存儲(chǔ)器
6．5．1 工作原理
6．5．2 映像方式
6．5．3 替換算法
6．6 虛擬存儲(chǔ)器
6．6．1 虛擬存儲(chǔ)器的概念
6．6．2 虛擬存儲(chǔ)器的基本管理方法
6．6．3 磁表面存儲(chǔ)器
6．6．4 光盤(pán)存儲(chǔ)器
6．7 實(shí)驗(yàn)設(shè)計(jì)
6．7．1 PC中的存儲(chǔ)器
6．7．2 AEDK實(shí)驗(yàn)機(jī)的存儲(chǔ)器
6．7．3 EL實(shí)驗(yàn)機(jī)的存儲(chǔ)器
習(xí)題6
第7章 系統(tǒng)總線(xiàn)
7．1 總線(xiàn)概述
7．1．1 總線(xiàn)的分類(lèi)
7．1．2 總線(xiàn)的工作原理
7．1．3 總線(xiàn)的主要性能參數(shù)
7．2 總線(xiàn)的通信
7．3 總線(xiàn)接口
7．3．1 總線(xiàn)接口的概念
7．3．2 常用的總線(xiàn)接口
習(xí)題7
第8章 輸入/輸出系統(tǒng)
8．1 輸入/輸出系統(tǒng)概述
8．1．1 輸入/輸出系統(tǒng)工作原理
8．1．2 輸入／輸出方式
8．2 輸入／輸出接口
8．2．1 接口的功能
8．2．2 接口的分類(lèi)
8．2．3 接口的組成結(jié)構(gòu)
8．2．4 CPU與I/O接口之間的數(shù)據(jù)交換方式
8．3 外部設(shè)備
8．3．1 常用輸入設(shè)備
8．3．2 常用輸出設(shè)備
8．4 實(shí)驗(yàn)設(shè)計(jì)
習(xí)題8